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Der netX ist ein hoch integrierter Netzwerk Controller mit einer neuen, auf Kommunikation und maximalen Datendurchsatz optimierten Systemarchitektur.
Basierend auf die mit 200 MHz getaktete 32-Bit CPU ARM 926EJ-S verfügt er über Memory Management Unit, Caches, DSP- und Java Erweiterungen. Der interne Speicher von 144 KByte RAM und 32 KByte ROM, der den Bootloader und einen Real-Time-Kernel enthält, ist für kleinere Applikationen ausreichend, während für Windows CE und Linux über den 32-Bit Memory-Controller Speicher extern mit SDRAM, SRAM oder FLASH erweitert wird. Die Anbindung an einen übergeordneten Host erfolgt über das Dual-Port-Memory Interface, welches für stand-alone Applikationen auch als 16-Bit Erweiterungsbus konfigurierbar ist. Umfangreiche Peripheriefunktionen, serielle Schnittstellen wie UART, USB, SPI, I2C sowie der integrierte Grafik-Controller erlauben ein großes Spektrum an Einsatzmöglichkeiten. Jedoch erst der zentrale Daten Switch und die vier frei konfigurierbaren
Kommunikationskanäle mit ihrer eigenen Intelligenz sind das Alleinstellungsmerkmal des netX als ‘high end’ Netzwerk Controller.
Der Daten Switch verbindet über fünf Datenpfade die ARM CPU und die Kommunikations-, Grafik- und Host-Controller mit dem Speicher oder den Peripherieeinheiten. Dadurch übertragen die Controller ihre Daten parallel, im Gegensatz zu traditionellen, sequentiellen Architekturen mit nur einem gemeinsamen Datenbus und zusätzlichen Buszuteilungszyklen.
Die Controller der vier Kommunikationskanäle sind zweistufig aufgebaut und untereinander identisch. Sie bestehen aus dedizierten ALUs und speziellen Logikeinheiten, die über Microcode ihre jeweilige Protokollfunktion zugewiesen bekommen. Für Ethernet enthalten zwei Kanäle zusätzlich einen integrierten PHY.
Der Medium-Access-Controller xMAC sendet bzw. empfängt Daten gemäß dem jeweiligen Buszugriffsverfahren und kodiert bzw. konvertiert diese in eine Byte-Darstellung.
Der Protocol-Execution-Controller xPEC fasst diese zu Datenpaketen zusammen und steuert den Telegrammverkehr. Diese werden per DMA blockweise über den Speicher der ARM ausgetauscht. Alternativ steht jedem Kanal ein Dual-Port-Memory für Statusinformationen oder als lokales Datenabbild zur Verfügung.
Mit den intelligenten Kommunikations-ALUs realisiert der netX die unterschiedlichsten Protokolle und Protokoll- Kombinationen und kann diese unabhängig von den Reaktionszeiten der CPU ynchronisieren - ein absolutes Novum in der industriellen Kommunikationstechnik.
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| Facts at a glance: |
| Flexible “high end” network controller or highly integrated single chip solution for applications and communication |
| Four communication channels as Real-Time Ethernet or fieldbus interface individually configurable |
| New system architecture optimized for communication and high data throughput |
| 32-Bit/200MHz CPU ARM 926 with 200 MIPs computing power for Windows CE and Linux |
| Dual-port-memory, AD converter and graphic controller on chip |
| Real-Time-Kernel in ROM |
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Product
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NETX 100+ML
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| Description
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netX 100 Network Controller + Master license
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| Microprocessor
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| Processor
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ARM 926EJ-S, 200 MIPS, ARMv5TE-command set with DSP- and Java-extension
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| Cache
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16 KByte commands / 8 KByte Data
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| Tightly coupled memory
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8 KByte Data
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| Memory Managment Unit
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Windows CE- and Linux-Support
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| Internal memory
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| RAM
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144 KByte, of this 16 KByte with external voltage supply
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| ROM
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32 KByte with Bootloader and Real-Time-Kernel
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| Ethernet interface
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| Ports
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2 x 10BASE-T/100BASE-TX, Half-/Full-Duplex, IEEE 1588 time stamp
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| PHY
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Integrated, Auto-Negotiation, Auto-Crossover
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| Real-Time-Ethernet
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EtherCAT with three FMMUs and four Sync-Manager
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| Ethernet/IP
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| Powerlink with integrated Hub
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| PROFINET RT with integrated Switch
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| SERCOS-III
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| Fieldbus-Interface
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| Channels
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In case Ethernet isn't used two addictional fieldbus interfaces are available. Theses system can be combined arbitrarily.
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| Systems
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AS-Interface, Master only
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| CANopen / DeviceNet
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| InterBus, Master only
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| PROFIBUS, Master and Slave
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| Peripherie
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| IEEE 1588 System Time
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32 Bit second counter, 32 Bit Nano second counter
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| USB
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Revision 1.1, 12 MBaud Full-Speed, Host- or Device-Mode
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| UART
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16550 compatible, max. 3 MBaud, RTS/CTS support Quantity 3
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| I2C
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| SPI
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Master- and Slave-Mode, max. 10 MHz, 3 Chip-Select-Signals
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| AD-Converter
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2 x 4 Channels with 1MS/s Sample&Hold and 10 Bit-resolution
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| Single ended, Common Analog Ground, external reference voltage
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| PWM
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0–20 kHz/12 Bit-resolution 0–80 kHz/10 Bit-resolution
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| Encoder
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2 Channels, Impuls quadruplication, digital input filter
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| General EAs
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3.3 V/6 mA Quantity 16
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| Status LEDs
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2 LEDs two-colors, 3.3 V/9 mA
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| Memory-Interface
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| Memory bus
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32 Bit-Databus/24 Bit-Address bus
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| Address region
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256 MByte SDRAM/64 MByte FLASH
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| Memory modules
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SDRAM, SRAM, FLASH
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| Host-Interface
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| Dual-port-memory-mode
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8/16 Bit-Databus, 64 KByte configurable in 8 Blocks, emulated by internal RAM
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| Extension-Mode
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8/16 Bit-Databus, 24 Bit-Address bus, Bustiming adjust table
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| PIO-Mode
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Freely programmable Inputs and Outputs
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| Debug-Interface
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| JTAG
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ARM-Processor and Boundary-Scan
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| ETM
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Embedded Trace Macrocell, ETM9 V2 Medium Size
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| Operating conditons/housings/various data
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| System cycles
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200 MHz ARM / 100 MHz Periphery
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| Signal level
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3.3 V
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| Power supply
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1.5 V for Core
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| 3.3 V for Input/Output
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| Operating temperature
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without heat sink –40..+70 °C
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| with heat sink 10°/W –40..+85 °C
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| Power input
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PHYs switched off typ. 1.0 W
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| PHYs switched on typ. 1.5 W
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| Housing
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PBGA, 1 mm Raster Pins 345
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| Dimensions mm 22 x 22
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